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METHOD AND APPARATUS FOR ADDRESS FIFO FOR HIGH BANDWIDTH COMMAND/ADDRESS BUSSES IN DIGITAL STORAGE SYSTEM

机译:数字存储系统中高带宽命令/地址总线的地址FIFO的方法和装置

摘要

A method of buffering a data stream in an electronic device using a first-in first-out (FIFO) buffer system wherein a first read latch signal does not change a pointer location of a read pointer. A dynamic random access memory (DRAM) and system are also disclosed in accordance with the invention to include a FIFO buffer system to buffer memory addresses and commands within the DRAM until corresponding data is available.
机译:一种使用先进先出(FIFO)缓冲系统在电子设备中缓冲数据流的方法,其中第一读取锁存器信号不更改读取指针的指针位置。根据本发明还公开了一种动态随机存取存储器(DRAM)和系统,其包括FIFO缓冲器系统,该FIFO缓冲器系统在DRAM内缓冲存储器地址和命令,直到可获得相应的数据为止。

著录项

  • 公开/公告号US2010199034A1

    专利类型

  • 公开/公告日2010-08-05

    原文格式PDF

  • 申请/专利权人 BRIAN JOHNSON;

    申请/专利号US20100758598

  • 发明设计人 BRIAN JOHNSON;

    申请日2010-04-12

  • 分类号G06F12/00;G06F3/00;

  • 国家 US

  • 入库时间 2022-08-21 18:52:32

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