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一种FPGA芯片布局中实现区域约束的方法

摘要

本发明实施例涉及一种FPGA芯片布局中实现区域约束的方法,包括:获取包括多个实例的网表、约束文件;根据约束文件创建约束区域,并将多个实例中受约束的实例置于对应的约束区域,以及创建全局区域,并将多个实例中不受约束的实例置于全局区域;当约束区域不存在约束错误时,进行芯片初始布局,为每个实例分配初始位置;通过布局算法移动多个实例,而后在当受约束的实例被移出对应的约束区域时,将受约束的实例移入对应的约束区域;判断芯片布局是否满足布局结束条件,若满足,则结束芯片布局。本发明在不增加布局算法的时间复杂度的情况下,实现区域约束的功能,保证了芯片布局在无约束、单个约束、多个约束等情况下布局功能的实现。

著录项

  • 公开/公告号CN106528921B

    专利类型发明专利

  • 公开/公告日2021-11-02

    原文格式PDF

  • 申请/专利权人 京微齐力(北京)科技有限公司;

    申请/专利号CN201610856186.X

  • 发明设计人 李明;樊平;

    申请日2016-09-27

  • 分类号G06F30/392(20200101);G06F111/04(20200101);

  • 代理机构11309 北京亿腾知识产权代理事务所(普通合伙);

  • 代理人陈霁

  • 地址 100083 北京市海淀区知春路63号卫星大厦9层901-903

  • 入库时间 2022-08-23 12:44:43

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