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一种乱序执行微处理器中的有条件加载指令

摘要

微处理器指令编译器将有条件加载指令编译成至少两个微指令。乱序执行流水线执行这些微指令。为了执行第一个微指令,一个执行单元从寄存器文件的源寄存器接收源操作数,并且作为响应这个执行单元使用这些源操作数产生第一结果。为了执行第二个微指令,一个执行单元接收目标寄存器的在前值及第一结果,并且作为响应,这个执行单元从由第一结果指定的存储单元读取数据且这个执行单元提供一个第二结果,如果满足条件则第二结果是此数据,并且如果不满足条件,则第二结果是目标寄存器的在前值。目标寄存器的在前值包含由执行一个微指令所产生的结果,其中这个微指令是关于第二个微指令的目标寄存器的次序上最近的在前写入者。

著录项

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2017-07-07

    授权

    授权

  • 2014-07-30

    实质审查的生效 IPC(主分类):G06F 9/30 申请日:20120406

    实质审查的生效

  • 2014-07-30

    实质审查的生效 IPC(主分类):G06F 9/30 申请日:20120406

    实质审查的生效

  • 2014-07-02

    公开

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  • 2014-07-02

    公开

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