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校准用于数字锁相回路(DPLL)的时间-数字转换器(TDC)的通电门控窗口的系统和方法

摘要

本发明揭示一种关于校准用于数字锁相回路(DPLL)的时间-数字转换器(TDC)的通电门控窗口的系统和方法。校准所述门控窗口以确保所述DPLL的适当操作,同时以功率有效方式操作所述TDC。明确地说,所述技术要求将所述TDC门控窗口的宽度设定为默认值;操作所述DPLL直到控制回路大体上锁定为止;将所述TDC门控窗口的所述宽度减少预定量,同时监测由所述DPLL的相位误差装置产生的相位误差信号;确定大体上在相位误差到达或跨越预定阈值时所述TDC门控窗口的当前宽度;且将所述TDC门控窗口的所述当前宽度增加预定量以针对所述TDC门控窗口的操作宽度加入误差容限。

著录项

  • 公开/公告号CN102017421B

    专利类型发明专利

  • 公开/公告日2013-11-06

    原文格式PDF

  • 申请/专利权人 高通股份有限公司;

    申请/专利号CN200980114110.8

  • 申请日2009-04-22

  • 分类号

  • 代理机构北京律盟知识产权代理有限责任公司;

  • 代理人宋献涛

  • 地址 美国加利福尼亚州

  • 入库时间 2022-08-23 09:16:16

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2020-04-14

    未缴年费专利权终止 IPC(主分类):H04L7/00 授权公告日:20131106 终止日期:20190422 申请日:20090422

    专利权的终止

  • 2013-11-06

    授权

    授权

  • 2013-11-06

    授权

    授权

  • 2011-06-01

    实质审查的生效 IPC(主分类):H03L7/085 申请日:20090422

    实质审查的生效

  • 2011-06-01

    实质审查的生效 IPC(主分类):H03L 7/085 申请日:20090422

    实质审查的生效

  • 2011-04-13

    公开

    公开

  • 2011-04-13

    公开

    公开

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