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延迟锁相环电路和操作延迟锁相环电路的方法

摘要

公开延迟锁相环电路和操作延迟锁相环电路的方法。一种延迟锁相环电路包括:占空比检测器,被配置为检测时钟信号的占空比,并基于检测的占空比确定是否执行粗略占空比校正;和延迟锁相环核。延迟锁相环核被配置为:根据占空比检测器的确定,选择性地对所述时钟信号执行粗略占空比校正,在与粗略占空比校正被执行的第二时间段不同的第一时间段期间对所述时钟信号执行粗略锁相,并对所述时钟信号执行精细占空比校正和精细锁相。

著录项

  • 公开/公告号CN109905123A

    专利类型发明专利

  • 公开/公告日2019-06-18

    原文格式PDF

  • 申请/专利权人 三星电子株式会社;

    申请/专利号CN201811477934.9

  • 发明设计人 金相谦;尹元柱;姜锡龙;张豪埈;

    申请日2018-12-05

  • 分类号H03L7/081(20060101);

  • 代理机构11286 北京铭硕知识产权代理有限公司;

  • 代理人史泉;王兆赓

  • 地址 韩国京畿道水原市

  • 入库时间 2024-02-19 11:37:04

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2019-06-18

    公开

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