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公开/公告号CN109905123A
专利类型发明专利
公开/公告日2019-06-18
原文格式PDF
申请/专利权人 三星电子株式会社;
申请/专利号CN201811477934.9
发明设计人 金相谦;尹元柱;姜锡龙;张豪埈;
申请日2018-12-05
分类号H03L7/081(20060101);
代理机构11286 北京铭硕知识产权代理有限公司;
代理人史泉;王兆赓
地址 韩国京畿道水原市
入库时间 2024-02-19 11:37:04
法律状态公告日
法律状态信息
法律状态
2019-06-18
公开
机译: 锁相环电路,其操作方法及其半导体存储器,能够减少锁相环电路的反馈延迟时间
机译: 延迟电路,锁相环具有延迟电路,处理器具有锁相环
机译:使用可编程延迟线电路的高效全数字锁相环
机译:使用可编程延迟线电路的高效所有数字锁相环
机译:用于GNSS信号跟踪的延迟锁相环辅助锁相环
机译:基于锁相环的时钟恢复电路中时间延迟的影响分析
机译:延迟触发器(DFF)的亚稳定性会影响时钟和数据恢复(CDR)以及锁相环(PLL)电路。
机译:高速调频原子力显微镜的宽带低延迟锁相环电路设计的定量比较
机译:一种基于自适应延迟锁相环的同步驱动方法,用于拼接CMOS图像传感器
机译:宽带锁相环电路