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LEAKAGE POWER OPTIMIZED SEQUENTIAL CIRCUITS FOR USE IN NANOSCALE VLSI SYSTEMS

机译：用于纳米级VLsI系统的漏电功率优化时序电路

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M. Janaki Rani; Dr. S. Malarkkan;
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年度 2012
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1. LEAKAGE POWER OPTIMIZED SEQUENTIAL CIRCUITS FOR USE IN NANOSCALE VLSI SYSTEMS [J] . M. Janaki Rani, Dr. S. Malarkkan Indian Journal of Computer Science and Engineering . 2012,第1期

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2. Stand by Leakage Power Reduction in Nanoscale Static CMOS VLSI Multiplier Circuits Using Self Adjustable Voltage Level Circuit [J] . Deeprose Subedi, Eugene John International Journal of VLSI Design & Communication Systems . 2012,第5期

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