机译:具有低功耗Cmos Vlsi电路的高效嵌入式逻辑的双动态触发器设计
机译:具有高效嵌入式逻辑的低功耗双动态节点脉冲混合触发器
机译:低功耗比较器逻辑电路的CMOS VLSI设计
机译:高效节能的双动态触发器设计,具有采用CMOS技术的嵌入式逻辑
机译:低功耗数字CMOS VLSI电路和设计方法。
机译:具有实际门延迟模型的CMOS组合逻辑电路的准确动态功率估算
机译:CMOS VLSI低功率比较逻辑电路设计
机译:批量CmOs VLsI技术研究。第1部分:可扩展CmOs设计规则。第2部分pLa(可编程逻辑阵列)设计的CmOs方法