机译:降低毛刺功率的高效算法[CMOS逻辑电路]
机译:CMOS VLSI数字电路设计中用于减少泄漏的BackTrack输入矢量算法
机译:通过输入矢量控制减少CMOS VLSI电路中的漏电流
机译:具有高度并行数据路径的2.72GOPS / 11mW低功耗可重配置加速器,由65nm CMOS组合电路组成
机译:一种通过动态运行时算法降低CMOS VLSI电路功耗的技术。
机译:随机纳米氮化钛晶粒引起的动态功率延迟的特性波动以及全能门纳米线CMOS器件和电路的纵横比效应
机译:CMOS VLSI数字电路IVC漏功率降低算法