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【2h】

Next Generation Neural Interfaces for low-power multichannel spike sorting

机译：用于低功率多通道尖峰分选的下一代神经接口

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作者
Luan S; Williams I; De Carvalho F; Jackson A; Quian Quiroga R; Constandinou TG;
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年度 2016
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1. A bidirectional neural interface SoC with an integrated spike recorder, microstimulator, and low-power processor for real-time stimulus artifact rejection [J] . Limnuson Kanokwan, Lu Hui, Chiel Hillel J., Analog Integrated Circuits and Signal Processing . 2015,第2期

机译：带有集成式峰值记录器，微刺激器和低功耗处理器的双向神经接口SoC，用于实时抑制刺激伪像
2. Low-power MicroV(rms) noise neural spike detector for implantable interface microsystem device [J] . Li Hongge, Bai Huixin, Xu Qicheng, Microelectronics & Reliability . 2015,第5期

机译：用于植入式接口微系统设备的低功耗MicroV（rms）噪声神经尖峰检测器
3. A low-power integrated neural interface with digital spike detection and extraction [J] . Benoit Gosselin, Mohamad Sawan Analog Integrated Circuits and Signal Processing . 2010,第1期

机译：具有数字峰值检测和提取功能的低功耗集成神经接口
4. Efficient online feature extraction algorithm for spike sorting in a multichannel FPGA-based neural recording system [C] . Li Peng, Liu Ming, Zhang Xu, IEEE biomedical circuits and systems conference . 2014

机译：基于多通道FPGA的神经记录系统中用于峰排序的高效在线特征提取算法
5. An integrated multichannel neural recording system with spike outputs. [D] . Li, Yuan. 2007

机译：具有尖峰输出的集成多通道神经记录系统。
6. To sort or not to sort: the impact of spike-sorting on neural decoding performance [O] . Sonia Todorova, Patrick Sadtler, Aaron Batista, -1

机译：排序还是不排序：尖峰排序对神经解码性能的影响
7. A low-power cmos neural amplifier with amplitude measurements for spike sorting [O] . T. Horiuchi, T. Swindell, P. Abshire 2004

机译：具有幅度测量功能的低功率cmos神经放大器，用于尖峰分类

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