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【2h】

Noise and Transient Response Characteristics of Digital Phase-Locked Loops

机译：数字锁相环的噪声和瞬态响应特性

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作者
KOIZUMI Takuya; TANIGUCHI Shuji;
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年度 1981
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1. An All-Digital Approach to Supply Noise Cancellation in Digital Phase-Locked Loop [J] . Won Namgoong IEEE transactions on very large scale integration (VLSI) systems . 2016,第3期

机译：全数字方法消除数字锁相环中的噪声
2. Quantization Noise Analysis of Time-to-Digital-Converter-Based All-Digital Phase-Locked Loop and Frequency Discriminators [J] . Park Sungkyung, Park Chester Sungchung Journal of circuits, systems and computers . 2016,第11期

机译：基于时间到数字转换器的全数字锁相环和鉴频器的量化噪声分析
3. Compact Modeling of Phase-Locked Loop Frequency Synthesizer for Transient Phase Noise and Jitter Simulation [J] . Liu Lechang, Pokharel Ramesh Computer-Aided Design of Integrated Circuits and Systems, IEEE Transactions on . 2016,第1期

机译：锁相环频率合成器的紧凑模型，用于瞬态相位噪声和抖动仿真
4. A 1.5GHz 1.35mW −112dBc/Hz in-band noise digital phase-locked loop with 50fs/mV supply-noise sensitivity [C] . Elshazly Amr, Inti Rajesh, Talegaonkar Mrunmay, VLSI Circuits (VLSIC), 2012 Symposium on . 2012

机译：1.5GHz 1.35mW −112dBc / Hz带内噪声数字锁相环，具有50fs / mV的电源噪声灵敏度
5. A low noise, wideband digital phase-locked loop based on a new time-to-digital converter with subpicosecond resolution. [D] . Lee, Min Jae. 2008

机译：基于亚皮秒分辨率的新型时间数字转换器的低噪声宽带数字锁相环。
6. Self-organized synchronization of digital phase-locked loops with delayed coupling in theory and experiment [O] . Lucas Wetzel, David J. Jörg, Alexandros Pollakis, -1

机译：具有延迟耦合的数字锁相环的自组织同步理论与实验
7. Noise and Transient Response Characteristics of Digital Phase-Locked Loops [O] . KOIZUMI Takuya, TANIGUCHI Shuji 1981

机译：数字锁相环的噪声和瞬态响应特性
8. STEADY STATE AND TRANSIENT ANALYSIS OF A DIGITAL BIT-SYNCHRONIZATION PHASE-LOCKED LOOP, [R] . cessna,james r. 1970

机译：数字位同步锁相环的稳态和瞬态分析，

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