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机译:一种用于串扰延迟分析的高效电流逻辑单元模型
Debasish Das; William Scott; Shahin Nazarian; Hai Zhou;
机译:用于串扰延迟分析的高效基于电流的逻辑单元模型
机译:高速GaAs逻辑电路中的多导体总线建模以及串扰,传播延迟和脉冲失真分析
机译:使用延迟代数方程的RLC互连的有效延迟和串扰建模
机译:用于串扰延迟分析的基于电流的高效逻辑单元模型
机译:基于统计延迟模型的逻辑电路设计性能分析与优化
机译:基于逻辑的单元信令网络分析模型
机译:用于串扰延迟分析的高效电流逻辑单元模型*
机译:使用多个单元模型的失真波形传播和串扰延迟分析
机译:确定逻辑单元模型中的延迟的方法
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