机译:可测试性设计技术,用于检测CMOS / BiCMOS逻辑系列中的延迟故障
机译:可测试性设计技术,用于检测CMOS / BiCMOS逻辑系列中的延迟故障
机译:采用180nm CMOS技术的1.7GHz低功耗可延迟故障测试的32b ALU的设计
机译:DFT技术用于32位高性能CMOS ALU中的延迟故障可测试性和诊断
机译:高性能,鲁棒的数据路径设计,具有针对规模化CMOS技术的延迟诊断功能。
机译:建立故障检测数据以帮助诊断算法创建和性能测试
机译:Triscan:一种用于CmOs路径延迟故障测试的新型DFT技术
机译:容错系统中的潜在故障和覆盖。一种用于辅助测试生成的VLsI CmOs电路设计技术