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机译:一种新的aEs电路中sBox奇偶校验位方案
G. Di Natale; M. L. Flottes; B. Rouzeyre;
机译:具有检错电路的低功耗AES SBOX的设计与实现
机译:具有非详尽测试集的VLSI电路的响应数据压缩和内置自测试中的奇偶校验位签名
机译:AES电路中SBox的新型奇偶校验位方案
机译:用于集成电路和量子密码学的低密度奇偶校验解码器架构。
机译:通过电路QED中的参数驱动进行Qubit奇偶校验测量
机译:在QCA中使用奇偶校验预测器电路2位和4位乘法器中的错误检测
机译:多组高速缓存结构,其具有奇偶校验RAM,这些RAM包含用于预测和生成所需奇偶校验位的预测电路的标记数据和状态数据的奇偶校验位
机译:AES Rijndael AES Rijndael加密和解密电路,具有次圆级流水线方案
机译:三乘三位奇偶校验电路-仅使用四个CMOS XOR门获取正确的数据以及一个奇偶校验位
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