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机译:maRs-C:组合电路中软错误的建模和减少
Natasa Miskov-zivanov; Diana Marculescu;
机译:在工艺变化的情况下使用门调整大小来降低组合电路的软错误率
机译:使用神经网络建模近阈值组合电路中的软误差传播
机译:健壮的触发器电路,可防止组合和顺序逻辑电路出现软错误
机译:MARS-C:建模和减少组合电路中的软错误
机译:纳米级CMOS组合逻辑电路中的辐射诱发的软错误机制。
机译:脑建模工具包:用于脑电路电路的多尺度建模的开源软件套件
机译:过程动态数据的减少和数学建模中产生的错误最终报告
机译:减少逻辑电路中软错误的方法和装置
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