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机译:纳米级CmOs电路泄漏
Saibal Mukhopadhyay; Hamid Mahmoodi-meim; Ra Neau; Kaushik Roy;
机译:具有地塌陷的电源开关:同时控制纳米级CMOS电路中的亚阈值和栅极泄漏电流
机译:基于器件几何形状和掺杂轮廓的纳米级体CMOS电路中总泄漏的准确估计
机译:基于行的功率门控:一种用于纳米CMOS电路中泄漏功率优化的新型睡眠晶体管插入方法
机译:纳米级CMOS电路中亚阈值和栅极漏电流的同时控制
机译:纳米级CMOS电路中降低待机泄漏功率的方法。
机译:用纳米重建3D纳米中的神经回路
机译:纳米CMOS技术中动态电路的泄漏功率特性
机译:具有使用MT-CMOS构造的漏电流截止电路的半导体集成电路器件,用于减小待机漏电流
机译:用于高级CMOS工艺的集成电路低泄漏功率电路
机译:带时钟的超大规模CMOS数字电路-使用延迟电路生成变化的延迟时钟脉冲来驱动子电路,从而减少开关电流浪涌
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