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A Two-Level Approach to Automated Conformance Testing of VHDL Designs

机译：VHDL设计自动一致性测试的两级方法

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作者
Jean Moonen; Judi Romijn; Olaf Sies; Loe Feijs; Ron Koymans;
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年度 1997
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2. Generation of design verification tests from behavioral VHDL programs using path enumeration and constraint programming [J] . Vemuri R., Kalyanaraman R. IEEE transactions on very large scale integration (VLSI) systems . 1995,第2期

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