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1 Experience with Improving Distributed Shared Cache Performance on Tilera’s Tile Processor

机译：1在Tilera的Tile处理器上提高分布式共享缓存性能的经验

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Inseok Choi; Minshu Zhao; Xu Yang; Donald Yeung;
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年度 2012
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1. Experience with Improving Distributed Shared Cache Performance on Tilera's Tile Processor [J] . Choi Inseok, Zhao Minshu, Yang Xu, Computer Architecture Letters . 2011,第2期

机译：在Tilera的Tile处理器上提高分布式共享缓存性能的经验
2. Multi-level spatial and temporal tiling for efficient HPC stencil computation on many-core processors with large shared caches [J] . Charles Yount, Alejandro Duran, Josh Tobin Future generation computer systems . 2019,第MARa期

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3. Dynamic tiling for effective use of shared caches on multithreaded processors [J] . Dimitrios S. Nikolopoulos International Journal of High Performance Computing and Networking . 2004,第1期

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4. Distributed cooperative shared last-level caching in tiled multiprocessor system on chip [C] . Damodaran Preethi P, Wallentowitz Stefan, Herkersdorf Andreas 2014 Design, Automation amp; Test in Europe Conference and Exhibition . 2014

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5. Performance bound energy efficient cache organization for multi-core processors: A comparison of private and shared cache. [D] . Arun, Ramya. 2010

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