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Primitive Delay Faults: Identification, Testing and Design for Testability

机译：原始延迟故障：可测试性的识别，测试和设计

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Angela Krstic; Kwang-Ting (Tim) Cheng; Srimat T. Chakradhar;
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年度 2007
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1. Primitive delay faults: identification, testing, and design for testability [J] . Krstic A., Kwang-Ting Cheng IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems . 1999,第6期

机译：原始延迟故障：可测试性的识别，测试和设计
2. Design-for-testability for path delay faults in large combinational circuits using test points [J] . Pomeranz I., Reddy S.M. IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems . 1998,第4期

机译：使用测试点的大型组合电路中路径延迟故障的可测试性设计
3. Reduction in Over-Testing of Delay Faults through False Paths Identification　Using RTL Information [J] . Yuki YOSHIKAWA, Satoshi OHTAKE, Hideo FUJIWARA 電子情報通信学会技術研究報告. ディペンダブルコンピュ-ティング. Dependable Computing . 2007,第528期

机译：使用RTL信息通过错误路径识别减少延迟故障的过度测试
4. Design for primitive delay fault testability [C] . Kristic, A., Chakradhar, . 1997

机译：基本延迟故障可测试性设计
5. New test generation methods for transition delay faults in scan designs. [D] . Zhang, Zhuo. 2006

机译：扫描设计中过渡延迟故障的新测试生成方法。
6. The Role of Genetic Testing in the Identification of Young Athletes with Inherited Primitive Cardiac Disorders at Risk of Exercise Sudden Death [O] . Francesco Danilo Tiziano, Vincenzo Palmieri, Maurizio Genuardi, 2016

机译：基因测试在识别患有运动猝死风险的遗传性原发性心脏疾病的年轻运动员中的作用
7. Design-for-testability for path delay faults for large combinational circuits using test-points [O] . Irith Pomeranz, Sudhakar M. Reddy 1994

机译：使用测试点的大型组合电路的路径延迟故障的可测试性设计

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