AI写作工具
文献服务
退出
我的积分:
中文文献批量获取
外文文献批量获取
机译:同步设计中的单轨自定时逻辑电路
Frank Grassert; Dirk Timmermann;
机译:用可测试性设计掩盖同步时序电路中的冗余故障
机译:超越CMOS磁电自旋轨道器件的100 mV逻辑同步电路设计
机译:对“超越CMOS磁电自旋轨道器件的100 mV逻辑同步电路设计”的更正
机译:自定时数字电路的迭代环形和功耗感知设计技术。
机译:平均输出极化数据集用于表示温度对QCA设计的可逆逻辑电路的影响
机译:高效节能同步流水线设计的动态单轨自定时逻辑结构
机译:一种自定时同步CmOs电路设计方法
机译:设计电路系统,扩展现有方法以评估电路设计的可行性,执行电路设计的可行性评估,完善电路设计的第一决策规则,形成电路设计的第二决策规则的方法电路设计,用于为多个预先设计的电路块组织设计者的经验数据,提高胶粘逻辑分配效率,并在设计块之间分配胶粘的多个逻辑元素,并分配胶粘逻辑以在集成电路设备设计中执行方案,转换特定于电路块的接口,选择电路收集器,设计一种包含使能设备测试以验证a正确操作的设备,并开发行为测试台,项圈接口和接口系统
机译:具有单轨逻辑和关断功能的同步时钟全轨差分逻辑
抱歉,该期刊暂不可订阅,敬请期待!
目前支持订阅全部北京大学中文核心(2020)期刊目录。