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机译:通过进化多目标优化方法设计组合逻辑电路
Carlos A. Coello Coello; Arturo Hernández Aguirre;
机译:使用VRA处理器的组合逻辑电路的进化设计
机译:组合逻辑电路的进化设计
机译:顺序逻辑电路的进化设计的模块级三阶段方法
机译:组合逻辑电路的进化多目标设计
机译:使用人工神经网络和多目标进化算法对建筑设计进行多目标优化。
机译:进化多目标优化设计抗菌肽
机译:用于半导体集成电路逻辑电路设计的网表优化方法;使用相同方法辅助逻辑电路设计的装置;和可以在同一计算机上执行的计算机程序
机译:协助逻辑电路设计以在IC基板上放置单元并优化布线的方法,使用该方法协助逻辑电路设计的设备以及该设备可执行的计算机程序
机译:用于将电路放置在IC基板上并优化布线的单元的逻辑电路设计的辅助方法,用于使用said方法的用于逻辑电路设计的辅助设备以及可通过所述设备执行的计算机程序
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