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【2h】

Leakage Power Optimization Techniques for Ultra Deep Sub-Micron Multi-Level Caches

机译：超深亚微米多级高速缓存的漏电功率优化技术

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Nam Sung Kim; David Blaauw; Trevor Mudge;
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年度 2003
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1. Quantitative analysis and optimization techniques for on-chip cache leakage power [J] . Nam Sung Kim, Blaauw D., Mudge T. IEEE transactions on very large scale integration (VLSI) systems . 2005,第10期

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机译：深亚微米缓存存储器中减少泄漏能量的技术
3. Techniques for Leakage Energy Reduction in Deep Submicrometer Cache Memories [J] . Frustaci F., Corsonello P., Perri S., IEEE transactions on very large scale integration (VLSI) systems . 2006,第期

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4. Leakage power optimization techniques for ultra deep sub-micron multi-level caches [C] . Nam Sung Kim, Blaauw, D., . 2003

机译：超深亚微米多层缓存的泄漏功率优化技术
5. Deep sub-micron SRAM design for ultra-low leakage standby operation. [D] . Qin, Huifang. 2007

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6. Using caching and optimization techniques to improve performance of the Ensembl website [O] . Anne Parker, Eugene Bragin, Simon Brent, 2010

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7. Quantitative Analysis and Optimization Techniques for On-Chip Cache Leakage Power [O] . Nam Sung Kim, David Blaauw, Trevor Mudge 2005

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