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机译:静态Cmos门的短路功率耗散估计及其对传播延迟的影响
Akio Hirata; Hidetoshi Onodera; Keikichi Tamaru;
机译:考虑静态CMOS栅极短路电流的传播延迟估计
机译:考虑短路电流的静态CMOS栅极的传播延迟估计
机译:CMOS门中的传播延迟和短路功耗的分析估计
机译:静态CMOS栅极的短路功耗估算及其对传输延迟的影响
机译:估计CMOS数字电路的最大功率和延迟。
机译:具有实际门延迟模型的CMOS组合逻辑电路的准确动态功率估算
机译:CMOS门的传播延迟和短路功耗的解析估计
机译:具有信号BI-CMOS反相器传播延迟的同相BI-CMOS门
机译:具有单个BI-CMOS反相器传播延迟的同相BI-CMOS门
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