机译:从并行控制器的分层Petri网规范生成VHDL
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机译:有限状态机并行数组的VHDL描述的验证
机译:基于行为多进程VHDL描述的同步并行控制器综合
机译:利用时间独立性进行VHDL数字电路描述的并行,分布式,异步,先发性事件驱动的仿真。
机译:基于PWL功能的多涡旋混沌振荡器的FPGA实现的VHDL描述
机译:通信VHDL过程综合的同步控制器模型
机译:用于性能建模的并行超高速集成电路(VHsIC)硬件描述语言(VHDL)仿真