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Technology Mapping for High Performance Static CMOS and Pass Transistor Logic Designs

机译：高性能静态CMOS和传输晶体管逻辑设计的技术映射

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Yanbin Jiang; Sachin S. Sapatnekar; Cyrus Bamji;
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年度 2001
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1. Technology mapping for high-performance static CMOS and passtransistor logic designs [J] . Yanbin Jiang, Sapatnekar S.S., Bamji C. IEEE transactions on very large scale integration (VLSI) systems . 2001,第5期

机译：高性能静态CMOS和传输晶体管逻辑设计的技术映射
2. Super-cell design based on statically substrate-biased domino CMOS circuit: combinational logic cell with continuously variable transistor width [J] . Hironobu Takahashi, Yoshinobu Sakai, Toshiro Akino 電子情報通信学会技術研究報告. VLSI設計技術. VLSI Design Technologies . 2000,第645期

机译：基于静态衬底偏置的多米诺CMOS电路的超级单元设计：晶体管宽度连续可变的组合逻辑单元
3. Super-cell design based on statically substrate-biased domino CMOS circuit: combinational logic cell with continuously variable transistor width [J] . Hironobu Takahashi, Yoshinobu Sakai, Toshiro Akino 電子情報通信学会技術研究報告. 集積回路. Integrated Circuits and Devices . 2000,第647期

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4. A fast global gate collapsing technique for high performance designs using static CMOS and pass transistor logic [C] . Yanbin Jiang, Sapatnekar, S.S. . 1998

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