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Scalable FPGA-based Architecture for DCT Computation Using Dynamic Partial Reconfiguration

机译：使用动态部分重配置的可扩展的基于FPGA的DCT计算架构

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Jian Huang; Matthew Parris; Jooheung Lee; Ronald F. Demara;
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年度 2009
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1. Scalable FPGA-based Architecture for DCT Computation Using Dynamic Partial Reconfiguration [J] . JIAN HUANG, MATTHEW PARRIS, JOOHEUNG LEE, ACM Transactions on Embedded Computing Systems . 2010,第1期

机译：使用动态部分重配置的可扩展的基于FPGA的DCT计算架构
2. High-level design flow and environment for FPGA-based dynamic partial reconfiguration [J] . Ben Abdelali Abdessalem, Hannachi Marwa, Krifa Mohamed Nidhal, International journal of electronics . 2017,第7a9期

机译：基于FPGA的动态部分重配置的高级设计流程和环境
3. FPGA-based IP cores implementation for face recognition using dynamic partial reconfiguration [J] . Afandi Ahmad, Abbes Amira, Paul Nicholl, Journal of Real-Time Image Processing . 2013,第3期

机译：基于FPGA的IP核实现，用于使用动态部分重配置进行人脸识别
4. Scalable FPGA Architecture for DCT Computation Using Dynamic Partial Reconfiguration [C] . Jian Huang, Matthew Parris, Jooheung Lee, Proceedings of the 2008 international conference on engineering of reconfigurable systems amp; algorithms . 2008

机译：使用动态部分重配置进行DCT计算的可扩展FPGA体系结构
5. Flexible Partial Reconfiguration Based Design Architecture for Dataflow Computation [D] . Shah, Mihir. 2018

机译：基于灵活的部分重配置的数据流计算设计架构
6. Explicit Design of FPGA-Based Coprocessors for Short-Range Force Computations in Molecular Dynamics Simulations [O] . Yongfeng Gu, Tom VanCourt, Martin C. Herbordt -1

机译：基于FPGA协处理器的短程力计算在分子动力学模拟中的显式设计
7. FPGA-based IP cores implementation for facerecognition using dynamic partial reconfiguration [O] . Ahmad Afandi, Amira Abbes, Paul Nicholl, 2011

机译：基于FPGA的IP内核实现动态部分重配置进行识别
8. Architectural Support for Dynamic Reconfiguration of Large Scale Distributed211 Applications [R] . Shrivastava, S. K., Wheater, S. M. 1999

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