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机译:合成FPGA的数据路径电路,重点是面积最小化
Andy Ye; Jonathan Rose; David Lewis;
机译:串行路由资源对FPGA数据路径电路实现面积的影响
机译:FPGA中异或增强电路的面积最小化
机译:基于K-LUT的FPGA电路的功耗感知,深度优化和面积最小化映射
机译:最小化阈值电压变化及其对电路和FPGA的影响。
机译:设计出健壮的DNA分离式接近电路并将电路泄漏降至最低
机译:面向硅调试应用的面向数据路径的可合成嵌入式FPGA架构
机译:利用数据路径线最小化来生成集成电路的数据路径平面图的方法和装置
机译:集成电路设计和制造的数据路径的方法和装置
机译:用于集成电路设计和制造的数据路径的综合方法和装置
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