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Digital Background Correction of Harmonic Distortion in Pipelined ADCs

机译：流水线ADC谐波失真的数字背景校正

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Andrea Panigada; Student Member; Ian Galton;
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年度 2006
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1. Digital Background Correction of Harmonic Distortion in Pipelined ADCs [J] . Panigada A., Galton I. IEEE transactions on circuits and systems . I , Regular papers . 2006,第9期

机译：流水线ADC谐波失真的数字背景校正
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3. DIGITAL BACKGROUND CALIBRATION OF CAPACITOR MISMATCHES AND HARMONIC DISTORTION IN PIPELINED ADC [J] . Wu Chubin, Zhang Zhang, Gao Shanqing, 电子科学学刊（英文版） . 2013,第003期

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4. A 130mW 100MS/s pipelined ADC with 69dB SNDR enabled by digital harmonic distortion correction [C] . Panigada A., Galton I. Solid-State Circuits Conference - Digest of Technical Papers, 2009. ISSCC 2009 . 2009

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