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【2h】

VHDL modeling and simulation of a digital image synthesizer for countering ISAR

机译：用于对抗ISAR的数字图像合成器的VHDL建模和仿真

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机译：批准公开发行，发行不受限制

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作者
Kantemir Ozkan;
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年度 2003
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1. False-target image synthesizer for countering ISAR via inverse dechirping [J] . Xizhang Wei, Shaokun Xu, Bo Peng, Systems Engineering and Electronics, Journal of . 2016,第1期

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3. A Digital False-Target Image Synthesizer Method Against ISAR Based on Polyphase Code and Sub-Nyquist Sampling [J] . Li Guang-Ming, Zhang Qun, Su Ling-Hua, IEEE Geoscience and Remote Sensing Letters . 2020,第3期

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4. A Digital Image Generator As a Counter-Measure Against ISAR [C] . Chen Zhou, Jianguo Wang Testing and Diagnosis, 2009. ICTD 2009 . 2009

机译：数字图像生成器作为对抗ISAR的对策
5. Novel fast locking digital phase locked loop: Behavioral modeling and simulations using VHDL-AMS. [D] . Nannaka, Anurag. 2010

机译：新型快速锁定数字锁相环：使用VHDL-AMS的行为建模和仿真。
6. Towards Standardization of X-ray Beam Filters in Digital Mammography and Digital Breast Tomosynthesis: Monte Carlo simulations and analytical modelling [O] . Suman Shrestha, Srinivasan Vedantham, Andrew Karellas -1

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7. VHDL modeling and simulation for a digital target imaging architecture for multiple large targets generation [O] . Bergon Hakan 2002

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