机译:FD-SOI和体CMOS技术中的高性能64位加法器的热感知设计和比较分析
机译:一个31.3 dBm批量CMOS T / R开关,使用堆叠式晶体管,在浮动p阱中具有子设计规则通道长度
机译:采用准多米诺动态全加法器设计的200 MHz CMOS流水线乘法累加器
机译:使用新的流水线全加法器单元设计的CMOS乘法器-累加器的位级流水线实现
机译:32位Brent Kung加法器(CMOS逻辑)的布局设计
机译:基于自适应非线性斜坡发生器和双差分自动归零技术的全差分流水线采样量化的高度线性CMOS图像传感器设计
机译:使用亚微米CMOS技术设计高速,6位管线ADC,内置数字误差校正单元。