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【2h】

Parallel Hardware- and Software Threads in a Dynamically Reconfigurable System on a Programmable Chip

机译：可编程芯片上动态可重配置系统中的并行硬件和软件线程

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Rößler Marko;
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年度 2013
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机译：一种针对未来移动通信中针对灵活应用量身定制的硬件/软件系统设计的并行动态可重配置架构
2. Hardware Software Co-design of H.264 Baseline Encoder on Coarse-Grained Dynamically Reconfigurable Computing System-on-Chip [J] . Hung K. NGUYEN, Peng CAO, Xue-Xiang WANG, IEICE transactions on information and systems . 2013,第3期

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3. Hardware Software Co-design of H.264 Baseline Encoder on Coarse-Grained Dynamically Reconfigurable Computing System-on-Chip [J] . Hung K. NGUYEN, Peng CAO, Xue-Xiang WANG, IEICE Transactions on Information and Systems . 2013,第3期

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4. Reconfigurable Systems and Flexible Programming for Hardware Design, Verification and Software Enablement for System-on-a-Chip Architectures [C] . Aylward J., Crawford C.H., Inoue K., 2011 International Conference on Reconfigurable Computing and FPGAs . 2011

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