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【2h】

8-Bit 250-MS/s ADC Based on SAR Architecture with Novel Comparator at 70nm Technology Node

机译：基于SAR架构的8位250-MS / s ADC，在70nm技术节点处具有新型比较器

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作者
Daulatabad Shreeniwas; Neema Vaibhav; Shah Ambika Prasad; Singh Praveen;
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年度 2016
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1. 8-Bit 250-MS/s ADC Based on SAR Architecture with Novel Comparator at 70nm Technology Node [J] . Shreeniwas Daulatabad, Vaibhav Neema, Ambika Prasad Shah, Procedia Computer Science . 2016,第1期

机译：在70 nm技术节点上基于SAR架构和新型比较器的8位250-MS / s ADC
2. An 8-bit 0.35-V 5.04-fJ/Conversion-Step SAR ADC With Background Self-Calibration of Comparator Offset [J] . Rabuske Taimur, Rabuske Fabio, Fernandes Jorge, Very Large Scale Integration (VLSI) Systems, IEEE Transactions on . 2015,第7期

机译：具有比较器失调的背景自校准功能的8位0.35-V 5.04-fJ /转换步SAR ADC
3. An 8-bit 180-kS/s differential SAR ADC with a time-domain comparator and7.97-ENOB [J] . Fan Hua, Wei Qi, Kobenge Sekedi Bomeh, Journal of Semiconductors . 2010,第9期

机译：具有时域比较器和7.97-ENOB的8位180kS / s差分SAR ADC
4. An Improved Dynamic Latch Based Comparator for 8-Bit Asynchronous SAR ADC [C] . Bekal Anush, Joshi Rohit, Goswami Manish, IEEE Computer Society Annual Symposium on VLSI . 2015

机译：改进的基于动态锁存器的8位异步SAR ADC比较器
5. Design and analysis of a low-power 8-bit 500 KS/s SAR ADC for bio-medical implant devices [D] . Mazidi, Ehsan. 2016

机译：用于生物医学植入装置的低功耗8比特500 ks / s SAR ADC的设计与分析
6. A Radiation-Hardened SAR ADC with Delay-Based Dual Feedback Flip-Flops for Sensor Readout Systems [O] . Duckhoon Ro, Changhong Min, Myounggon Kang, 2020

机译：具有基于延迟的双反馈触发器的防辐射SAR ADC用于传感器读出系统
7. A 1-V 690 #x03BC;W 8-bit 200 MS/s flash-SAR ADC with pipelined operation of flash and SAR ADCs in 0.13#x03BC;m CMOS [O] . Monireh Eslami, Mohammad Taherzadeh-Sani, Frederic Nabki 2015

机译：具有0.13μmCMOS的闪光灯和SAR ADC的1-V690μW8位200 MS / S闪存SAR ADC

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