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机译:在FPGA上用于浮点双精度及更高乘法器
Banescu Sebastian; de Dinechin Florent; Pasca Bogdan; Tudoran Radu;
机译:FPGA上的运行时可重新配置的多精度浮点矩阵乘法器知识产权内核
机译:Karatsuba技术实现双精度浮点乘法器的VLSI实现
机译:高效实现FPGA上的IEEE双精度浮点倍增器
机译:含咖啡因的FPGA:用于训练和推理卷积神经网络的FPGA框架,具有降低的精度浮点算法
机译:基于模型的设计浮点累加器。研究案例:支持向量机内核功能的FPGA实现
机译:用于FpGa的浮点双精度和超越的乘法器
机译:用于在操作模式下计算单精度,双精度,内积并乘以复数的乘法器
机译:能够计算双精度,单精度,内积和乘以复数的乘法器
机译:能够计算双精度,单精度,内积和乘法复数的乘法器
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