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Reduction of target fault list for crosstalk-induced delay faults by using layout constraints

机译：通过使用布局约束来减少串扰引起的延迟故障的目标故障列表

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作者
Keller Keith J.; Takahashi Hiroshi; Le Kim T.; Saluja Kewal K.; Takamatsu Yuzo;
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作者单位

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年度 2002
总页数
原文格式 PDF
正文语种 {"code":"en","name":"English","id":9}
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1. Reduction of the Target Fault List and Fault Simulation Method for Crosstalk Faults in Clock-Delayed Domino Circuits [J] . Kazuya SHIMIZU, Takanori SHIRAI, Masaya TAKAMURA, IEICE Transactions on Information and Systems . 2002,第10期

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2. A method to identify target crosstalk-induced delay faults in sequential circuits [J] . Hiroshi Takahashi, Keith J. Keller, Kewal K. Saluja, 電子情報通信学会技術研究報告. フォ-ルトトレラントシステム . 2001,第658期

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3. A method to identify target crosstalk-induced delay faults in sequential circuits [J] . Hiroshi Takahashi, Keith J. Keller, Kewal K. Saluja, 電子情報通信学会技術研究報告. フォ-ルトトレラントシステム . 2001,第658期

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4. Reduction of target fault list for crosstalk-induced delay faults by using layout constraints [C] . Keller K.J., Takahashi H., Le K.T., Test Symposium, 2002. (ATS '02). Proceedings of the 11th Asian . 2002

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