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机译:减少同步时序电路中串扰故障的目标故障列表的方法
Takahashi Hiroshi; Keller Keith J.; Le Kim T.; Saluja Kewal K.; Takamatsu Yuzo;
机译:时钟延迟多米诺电路中串扰故障的目标故障列表的减少和故障仿真方法
机译:时序电路中目标串扰引起的延迟故障的识别方法
机译:减少同步时序电路中串扰引起的延迟故障的目标故障清单
机译:时序电路中串扰故障的高级测试方法
机译:故障的鲁棒性促进了可扩展性:不断发展的数字电路的见解
机译:用布尔差分技术分析同步时序电路中的多个故障
机译:产生故障电路元件的候选列表的方法以及使用所述候选列表在数字逻辑电路中隔离故障的方法。
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