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Partitioning and Scheduling DSP Applications with Maximal Memory Access Hiding

机译：具有最大内存访问隐藏功能的DSP应用程序分区和调度

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Zhong Wang; Edwin Hsing-Mean Sha; Yuke Wang;
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年度 2003
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1. Partitioning and Scheduling DSP Applications with Maximal Memory Access Hiding [J] . Zhong Wang, Edwin Hsing-Mean Sha, Yuke Wang EURASIP journal on applied signal processing . 2002,第9期

机译：具有最大内存访问隐藏功能的DSP应用程序分区和调度
2. Partitioning and Scheduling DSP Applications with Maximal Memory Access Hiding [J] . Zhong Wang, Edwin Hsing-Mean Sha, Yuke Wang EURASIP journal on advances in signal processing . 2002,第9期

机译：具有最大内存访问隐藏功能的DSP应用程序分区和调度
3. Minimization of memory access overhead for multidimensional DSP applications via multilevel partitioning and scheduling [J] . Wang J.Q., Hsing-Mean Sha E. IEEE Transactions on Circuits and Systems. II . 1997,第9期

机译：通过多级分区和调度将多维DSP应用程序的内存访问开销降至最低
4. Optimal two level partitioning and loop scheduling for hiding memory latency for DSP applications [C] . Zhong Wang, Michael Kirkpatrick, Edwin Hsing-Mean Sha Conference on Design automation . 2000

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5. Study on DSP algorithm implementation techniques and memory access reduction for DSP algorithm implementation on Digital Signal Processor. [D] . Liu, Xiangyang. 2010

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7. Partitioning and Scheduling DSP Applications with Maximal Memory Access Hiding [O] . Zhong Wang, Edwin Hsing-Mean Sha, Yuke Wang 2002

机译：具有最大内存访问隐藏功能的DSP应用程序分区和调度
8. Latency Hiding in Dynamic Partitioning and Load Balancing of Grid Computing Applications [R] . Das, S. K. , Harvey, D. J. , Biswas, R. 2001

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