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机译:利用时钟脉冲发生器合成遗传时序逻辑电路
Chia-Hua Chuang; Chun-Liang Lin;
机译:使用时钟差分共源共栅绝热逻辑(CDCAL)的低功耗组合和顺序逻辑电路
机译:用于超低功率应用的可逆能量恢复逻辑电路及其8相时钟发生器
机译:基于门控时钟和脉冲使能逻辑的基于时序电路的ALU的功率优化
机译:时钟逻辑自动映射到准延迟不敏感电路。
机译:用时钟脉冲发生器合成遗传序列逻辑电路
机译:开关二极管时钟脉冲发生器(Cpg),用于提供三个时钟周期的磁逻辑元件
机译:动态时钟脉冲调节装置,用于检测CPU的实时工作状态,具有时钟脉冲发生器,用于根据从逻辑电路接收到的信号来调节其输出时钟脉冲
机译:用于时钟脉冲控制逻辑电路的时钟脉冲发生器电路
机译:用于顺序数据输入的同步数据扫描电路,在时钟脉冲间隔期间以低逻辑在第一脉冲信号的边缘扫描数据单元
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