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【2h】

A continuous-time delta-sigma ADC with integrated digital background calibration

机译：具有集成数字背景校准功能的连续时间delta-sigma ADC

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作者
Siyu Tan; Yun Miao; Mattias Palm; Joachim Neves Rodrigues; Pietro Andreani;
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作者单位

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年度 2016
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1. A continuous-time delta-sigma ADC with integrated digital background calibration [J] . Tan Siyu, Miao Yun, Palm Mattias, Analog Integrated Circuits and Signal Processing . 2016,第2期

机译：具有集成数字背景校准功能的连续时间delta-sigma ADC
2. Correction to “A Mostly-Digital Variable-Rate Continuous-Time Delta-Sigma Modulator ADC” [J] . Taylor G., Galton I. Solid-State Circuits, IEEE Journal of . 2011,第5期

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3. A Mostly-Digital Variable-Rate Continuous-Time Delta-Sigma Modulator ADC [J] . Taylor G., Galton I. Solid-State Circuits, IEEE Journal of . 2010,第12期

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4. Digital background calibration in continuous-time delta-sigma analog to digital converters [C] . Siyu Tan, Yun Miao, Palm Mattias, 2015 Nordic Circuits and Systems Conference: NORCHIP amp; International Symposium on System-on-Chip . 2015

机译：连续时间delta-sigma模数转换器中的数字背景校准
5. Background digital calibration of SAR ADC with fast FPGA emulation. [D] . Wang, Guanhua. 2013

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6. Time-Interleaved SAR ADC with Background Timing-Skew Calibration for UWB Wireless Communication in IoT Systems [O] . Kiho Seong, Dong-Kyu Jung, Dong-Hyun Yoon, 2020

机译：物联网系统中用于UWB无线通信的具有时间时序校正的时间交错SAR ADC
7. A continuous-time delta-sigma ADC with integrated digital background calibration [O] . Tan, Siyu, Miao, Yun, Palm, Mattias, 2016

机译：具有集成数字背景校准的连续时间Δ-ΣaDC

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