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Fault Tolerance Limits and Input Stimulus Selection using an Implemented FPGA-based Testing System

机译：使用基于FPGA的已实现测试系统实现容错极限和输入激励选择

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Δημοσιεύσεις μελών--ΣΤΕΦ--Τμήμα Ηλεκτρονικών Μηχανικών,2014

机译：成员出版物-STEF-电子工程系，2014年

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作者
Vassios, Vasilios; Pouros, Sotirios; Papakostas, Dimitrios;
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作者单位

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年度 2014
总页数
原文格式 PDF
正文语种 en
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1. Fault Tolerance Limits and Input Stimulus Selection Using an Implemented FPGA-Based Testing System [J] . Papakostas K. Dimitrios, Pouros P. Sotirios, Vassios D. Vassilios Journal of Computer and Communications . 2014,第13期

机译：使用已实现的基于FPGA的测试系统实现容错极限和输入激励选择
2. Selection of Input Stimulus for Fault Diagnosis of Analog Circuits Using ARM A Model [J] . Adel A. K. Mohsen, M. F. Abu El-Yazeed AEU: Archiv fur Elektronik und Ubertragungstechnik: Electronic and Communication . 2004,第3期

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3. High Speed Fault Injection Tool Implemented With Verilog HDL on FPGA for Testing Fault Tolerance Designs [J] . G. Gopinath Reddy, A. Rajasekhar Yadav, Y. Mahesh International Journal of Engineering Research and Applications . 2013,第6期

机译：在FPGA上用Verilog HDL实现的高速故障注入工具，用于测试容错设计
4. Input stimulus comparison using an adaptive FPGA-based testing system [C] . Sotirios Pouros P., Vassilios Vassios D., Dimitrios Papakostas K., IEEE International Symposium on Circuits and Systems . 2014

机译：使用基于FPGA的自适应测试系统进行输入激励比较
5. Transition faults and transition path delay faults: Test generation, path selection, and built-in generation of functional broadside tests. [D] . Yao, Bo. 2013

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6. Challenges and Opportunities in Implementing the FDA Default Parametric Tolerance Interval Two One-Sided Test for Delivered Dose Uniformity of Orally Inhaled Products [O] . Greg Larner, Andrew Cooper, Svetlana Lyapustina, 2011

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