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【2h】

40 Gbit/s on-off-keyed system with 5.71 GHz clock recovery circuit using duty cycle division multiplexing

机译：40 Gbit / s的开关键系统，带有占空比分频复用的5.71 GHz时钟恢复电路

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We show the realization of 40 Gbit/s on-off-keyed system that can be recovered at 5.71 GHz clock using duty cycle division multiplexing technique with the receiver sensitivity of -22.1 dBm. Â©2008 Optical Society of America.

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作者
Amouzad Mahdiraji G.; Malekmohammadi A.; Fauzi Abas A.; Khazani Abdullah M.;
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作者单位

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年度 2009
总页数
原文格式 PDF
正文语种 {"code":"en","name":"English","id":9}
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