AI写作工具
文献服务
退出
我的积分:
中文文献批量获取
外文文献批量获取
机译:使用近似加法器的展位倍增器的设计与实现
Shital Keskar; Prof Mote T. S.;
机译:利用展位乘法器和进位跳过加法器实现冷杉过滤器
机译:使用Radix-2修改的Booth算法和使用Verilog的SPST加法器有效实现16位乘法累加器
机译:截断展开倍增器的设计,评估和应用
机译:混合加法器的高速修改展位乘法器的设计与实现
机译:浮点FPGA加法器/减法器和乘法器的实现。
机译:通过近似量子加法器的保护状态转移
机译:使用纹波进位加法器的展位乘法器设计
机译:f 3 Sub>(Σ CD Sub>) max Sup>的“ k”条件最大并行并行乘数f Σ的功能设计 Sub>(Σ CD Sub>),对“ [ 1,2 Sup> S g Sub> h1””参数进行“解密”的实现过程 Sup>]和[ 1,2 Sup> S g Sub> h2 Sup>]“补码RU”,由三进制数系统f(+ 1,0,-1)和逻辑区分d 1 Sub> / dn→f 1 Sub>( + Sup>←↓- Sub> ) d / dn Sub>(俄罗斯逻辑版本)
机译:实现高速,低功耗数字倍增器,倍增器或倍增器蓄积电路的电路布置
抱歉,该期刊暂不可订阅,敬请期待!
目前支持订阅全部北京大学中文核心(2020)期刊目录。