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机译:具有推测执行的高性能通用电路的低面积架设计方法
Shimpei SATO; Eijiro SASSA; Yuta UKON; Atsushi TAKAHASHI;
机译:一种实用的,低开销的单周期校正设计方法,用于耐变化的数字电路
机译:具有推测性预执行功能的低复杂度微处理器设计
机译:将推测性执行纳入控制流密集型设计的调度中
机译:具有推测执行功能的高性能通用同步电路的低面积架空设计
机译:CMOS技术中的双极性器件表征和设计,用于设计高性能低成本BiCMOS模拟集成电路
机译:基于超高纯度半导体碳纳米管的低压高性能柔性数字和模拟电路
机译:高性能,低控制开销的异步微分方程求解器的设计与验证
机译:设计电路系统,扩展现有方法以评估电路设计的可行性,执行电路设计的可行性评估,完善电路设计的第一决策规则,形成电路设计的第二决策规则的方法电路设计,用于为多个预先设计的电路块组织设计者的经验数据,提高胶粘逻辑分配效率,并在设计块之间分配胶粘的多个逻辑元素,并分配胶粘逻辑以在集成电路设备设计中执行方案,转换特定于电路块的接口,选择电路收集器,设计一种包含使能设备测试以验证a正确操作的设备,并开发行为测试台,项圈接口和接口系统
机译:提供特殊功能的高性能执行程序处理器的结构和方法
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