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A full matrix joint optimization method for hardware implementation of AES MixColumns/InvMixColumns

机译：AES MixColumns / InvmixColumns硬件实现的完整矩阵联合优化方法

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作者
Xiaoqiang ZHANG; Fan YANG; Xinxing ZHENG; Xinggan ZHANG; Ning WU;
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年度 2020
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1. A full matrix joint optimization method for hardware implementation of AES MixColumns/InvMixColumns [J] . Xiaoqiang ZHANG, Fan YANG, Xinxing ZHENG, IEICE Electronics Express . 2020,第24期

机译：AES MixColumns / InvmixColumns硬件实现的完整矩阵联合优化方法
2. Optimized Method for Sine and Cosine Hardware Implementation Generator, using CORDIC Algorithm [J] . A. Ait Madi, A. Addaim International Journal of Applied Engineering Research . 2018,第1aPta1期

机译：CORDIC算法的正弦和余弦硬件实现发生器优化方法
3. FIR filter design methodology for hardware optimized implementation [J] . Mehboob R., Khan S.A., Qamar R. Consumer Electronics, IEEE Transactions on . 2009,第3期

机译：用于硬件优化实现的FIR滤波器设计方法
4. Optimized Area and Optimized Speed Hardware Implementations of AES on FPGA [C] . Rizk M.R.M., Morsy M., IDT International Design and Test Workshop . 2007

机译：FPGA上AES的优化区域和优化速度硬件实现
5. Methods for detection and correction of matrix interferences in inductively coupled plasma-atomic emission spectroscopy (ICP-AES) and -mass spectrometry (-MS). [D] . Cheung, Yan. 2016

机译：在电感耦合等离子体原子发射光谱法（ICP-AES）和-质谱法（-MS）中检测和校正基质干扰的方法。
6. Learned sensing: jointly optimized microscope hardware for accurate image classification [O] . Alex Muthumbi, Amey Chaware, Kanghyun Kim, 2019

机译：学到的传感技术：共同优化的显微镜硬件可实现准确的图像分类
7. Research on Hardware Optimization Implementation and Application of AES Algorithm [O] . 郑行 2014

机译：AES算法的硬件优化实现与应用研究

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