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机译:基于PLL + DDS + PLL的频率合成器的设计与改进
Sun Ying; Yin Mei-liang; Xie Teng;
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机译:基于VHDL的可重用高性能直接数字频率合成器的设计和设计方法
机译:用于频率合成器的锁相环电路,具有连接到除数器的控制单元,该控制单元设计用于控制具有比较器功能的除数器,以及用于相位量化和输出反馈信号的多路复用器
机译:频率合成器对于无线电收发器,具有分数阶环路滤波器,可根据测得的分频与参考频率振荡器之间的相位差来控制振荡器
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