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【2h】

Two-Stage Internal DAC Mismatch Mitigation for a Continuous-Time Delta-Sigma ADC

机译：连续时间Delta-Sigma ADC的两阶段内部DAC失配缓解

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Marko Neitola;
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年度 2019
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1. New Feedback Architecture for VCO-Based Delta-Sigma ADCs Utilizing Phase Shifter [J] . Ali Mohammadi, Ahmad Ayatollahi, Adib Abrishamifar 电子科技学刊：英文版 . 2012,第003期
2. An audio ADC Delta-Sigma modulator with 100-dB peak SINAD and102-dB DR using a second-order mismatch-shaping DAC [J] . Fogelman E., Welz J., Galton I. IEEE Journal of Solid-State Circuits . 2001,第3期

机译：音频ADC Delta-Sigma调制器，具有二阶失配整形DAC，具有100dB的峰值SINAD和102dB的DR
3. A 3-mW 74-dB SNR 2-MHz Continuous-Time Delta-Sigma ADC With a Tracking ADC Quantizer in 0.13-μm CMOS [J] . Lukas Dorrer, Franz Kuttner, Patrizia Greco, IEEE Journal of Solid-State Circuits . 2005,第12期

机译：具有0.13μmCMOS的3mW 74dB SNR 2MHz连续时间Δ-ΣADC，具有跟踪ADC量化器
4. A continuous-time delta-sigma ADC for portable ultrasound scanners [J] . Muntal Pere Llimos, Jorgensen Ivan H. H., Bruun Erik Analog Integrated Circuits and Signal Processing . 2017,第3期

机译：用于便携式超声扫描仪的连续时间Δ-Sigma ADC
5. Approaches to mitigating the impact of DAC mismatch on the performance of continuous-time delta-sigma modulators [C] . Ding Chongjun, Manoli Yiannos, Keller Matthias IEEE International Symposium on Circuits and Systems . 2015

机译：减轻DAC不匹配对连续时间delta-sigma调制器性能的影响的方法
6. Design of a wideband quadrature continuous-time delta-sigma ADC. [D] . Yaghini, Navid. 2004

机译：宽带正交连续时间Δ-ΣADC的设计。
7. A 100-Mhz Bandwidth 80-dB Dynamic Range Continuous-Time Delta-Sigma Modulator with a 2.4-Ghz Clock Rate [O] . Yao Xiao, Zhifei Lu, Zhaofeng Ren, 2020

机译：具有2.4Ghz时钟速率的100Mhz带宽80dB动态范围连续时间Δ-Σ调制器
8. Delta-sigma modulators employing continuous-time circuits and mismatch-shaped DACs [O] . 1996

机译：采用连续时间电路和失配形DAC的Δ-Σ调制器

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