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机译:用于3D芯片堆栈的自动扶梯网络与电感耦合Thruchip接口
Akio Nomura; Yusuke Matsushita; Junichiro Kadomoto; Hiroki Matsutani; Tadahiro Kuroda; Hideharu Amano;
机译:具有电感耦合直通芯片接口的3D芯片堆栈的自动扶梯网络
机译:用于电感耦合直通芯片接口的高效3D总线架构
机译:具有电感性ThruChip接口的可扩展3D异构多核
机译:具有电感耦合通芯片接口的可扩展3D异构多核处理器
机译:3D堆叠芯片新兴技术的热感知优化
机译:具有3D堆叠140 GOPS列并行PE的1 ms高速视觉芯片的设计和性能
机译:三维堆叠芯片脉冲电感耦合连接的单相调制
机译:具有谐振时钟和电感耦合的3D芯片堆栈偏斜降低
机译:具有谐振时钟和感应耦合的3D芯片堆叠倾斜减少
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