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机译:两个相位时钟亚阈值绝热逻辑电路
Kazunari Kato; Yasuhiro Takahashi; Toshikazu Sekine;
机译:两相正弦功率锁定准绝热逻辑电路
机译:两阶段正弦功率时钟和时钟传输门的绝热逻辑电路设计
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机译:超低功耗,单时钟功率绝热电路逻辑。
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机译:通过绝热逻辑电路的时钟电源减少栅极泄漏
机译:多相电平时钟电路的最佳重定时
机译:绝热能量回收时钟提供时钟的MOS逻辑电路中的休眠模式
机译:包括控制逻辑电路的PLL电路,该控制逻辑电路用于调整时钟的延迟时间,从而减小时钟的相位误差
机译:基于量子相滑结的绝热逻辑电路及其应用
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