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【2h】

A Low-Area, Low-Power Dynamically Reconfigurable 64-Bit Media Signal Processing Adder

机译：低频，低功耗动态可重新配置的64位媒体信号处理加法器

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Priscilla Sharon Allwin; Chien-In Henry Chen;
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年度 2021
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1. A Low-Area, Low-Power Dynamically Reconfigurable 64-Bit Media Signal Processing Adder [J] . Priscilla Sharon Allwin, Chien-In Henry Chen Journal of Computer and Communications . 2021,第3期

机译：低频，低功耗动态可重新配置的64位媒体信号处理加法器
2. A Low-Area, Low-Power Dynamically Reconfigurable 64-Bit Media Signal Processing Adder [J] . Priscilla Sharon Allwin, Chien-In Henry Chen 电脑和通信（英文） . 2021,第003期

机译：低频，低功耗动态可重新配置的64位媒体信号处理加法器
3. Low-Power Mixed-Signal CVNS-Based 64-Bit Adder for Media Signal Processing [J] . Mirhassani M., Ahmadi M., Jullien G. A. IEEE transactions on very large scale integration (VLSI) systems . 2008,第9期

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4. Process and Temperature Invariant Bandwidth and Gain, Low-Area, Low-Power and High Swing G -C Filter for Multichannel Neuro-potential Signal Conditioning [C] . Anvesha Amaravati, Maryam Shojaei Baghini International symposium on low power electronics and design . 2012

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5. A design methodology for low-power heterogeneous reconfigurable digital signal processors. [D] . Wan, Marlene. 2001

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