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LOGIC RESYNTHESIS METHODS FOR LAYOUT DESIGN OF MICROELECTRONIC CIRCUITS

机译：微电子电路布局设计的逻辑重新合成方法

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N. O. Vasilyev; P.I. Frolova; G.A. Ivanova; A. N. Schelokov;
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年度 2020
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1. Methods and Algorithms for the Logical-Topological Design of Microelectronic Circuits at the Valve and Inter-Valve Levels for Promising Technologies with a Vertical Transistor Gate [J] . G. A. Ivanova, D. I. Ryzhova, S. V. Gavrilov, Russian Microelectronics . 2019,第3期

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2. Resynthesis of combinational logic circuits for improved path delayfault testability using comparison units [J] . Pomeranz I., Reddy S.M. IEEE transactions on very large scale integration (VLSI) systems . 2001,第5期

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3. Performance optimization of pipelined logic circuits using peripheral retiming and resynthesis [J] . Malik S., Singh K.J. IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems . 1993,第5期

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4. Basic Design Methods for CMOS Logic Circuits with Ordered Layout [C] . Zahnd J., Stauffer A. Ninth European Solid-State Circuits Conference (ESSCIRC '83) . 1983

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