Design of Smart Hybrid Power Supply using Logic Circuits

机译：使用逻辑电路设计智能混合电源

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Ahmed M. D. E. Hassanein;
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年度 2020
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1. Solid state: In smarter design and fabrication of ICs, power and logic are mixed on the same chip and circuits are integrated over an entire wafer [J] . Fischetti M.A. IEEE Spectrum . 1985,第1期

机译：固态：在更智能的IC设计和制造中，功率和逻辑混合在同一芯片上，电路集成在整个晶片上
2. A hybrid magnetic/complementary metal oxide semiconductor process design kit for the design of low-power non-volatile logic circuits [J] . G. Di Pendina, G. Prenat, B. Dieny, Journal of Applied Physics . 2012,第7pta3期

机译：用于低功耗非易失性逻辑电路设计的混合磁性/互补金属氧化物半导体工艺设计套件
3. Cell Design Methodology Based on Transmission Gate for Low-Power High-Speed Balanced XOR-XNOR Circuits in Hybrid-CMOS Logic Style [J] . Tooraj Nikoubin, Mahdieh Grailoo, Sayyed Hasan Mozafari Journal of Low Power Electronics . 2010,第4期

机译：基于传输门的混合CMOS逻辑低功耗高速平衡XOR-XNOR电路的单元设计方法
4. Breaking the Power-Delay Tradeoff: Design of Low-Power High-Speed MOS Current-Mode Logic Circuits Operating with Reduced Supply Voltage [C] . Badel, S., Leblebici, . 2007

机译：打破功耗延迟的折衷方案：以降低的电源电压工作的低功耗高速MOS电流模式逻辑电路设计
5. On the interdependence of substrate coupling on technology, circuit, and physical design in mixed-signal smart-power circuits. [D] . Secareanu, Radu Mircea. 2000

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6. Accurate dynamic power estimation for CMOS combinational logic circuits with real gate delay model [O] . Omnia S. Fadl, Mohamed F. Abu-Elyazeed, Mohamed B. Abdelhalim, 2016

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7. Breaking the power-delay tradeoff: design of low-power high-speed MOS current-mode logic circuits operating with reduced supply voltage [O] . Stéphane Badel, Yusuf Leblebici 2007

机译：打破功耗延迟的折衷方案：设计低电源电压的低功耗高速MOS电流模式逻辑电路
8. Static and Dynamic Performance of Micropower Transistor Logic Circuits. Part II. Micropower Logic Circuit Design [R] . Wagner, L. F., Meindl, J. D. 1967

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