机译:CMOS VLSI数字电路设计中用于减少泄漏的BackTrack输入矢量算法
机译:CMOS VLSI数字电路设计中通过自适应逻辑单元技术降低泄漏功率
机译:使用自调节电压电平电路的纳米级静态CMOS VLSI乘法器电路的待机泄漏功率降低
机译:用于降低CMOS VLSI电路中的泄漏功率的电路技术
机译:一种新颖的动态功率截止技术(DPCT),用于降低深亚微米VLSI CMOS电路中的有源泄漏。
机译:具有混合CMOS /忆阻器电路的Hopfield网络模数转换器的建模和实验演示
机译:CMOS VLSI数字电路漏功率降低的IVC和GR的组合方法